- 您现在的位置：买卖IC网 > Sheet目录335 > ISL9440BEVAL1Z (Intersil)EVAL BOARD 1 FOR ISL9440B
Block Diagram
BOOT1
UGATE1
PHASE1
VCC_5V
VCC_5V
ADAPTIVE DEAD-TIME
V/I SAMPLE TIMING
PGOOD
RST
VCC_5V VIN PGND
VCC_5V
ADAPTIVE DEAD-TIME
V/I SAMPLE TIMING
BOOT2
UGATE2
PHASE2
VCC_5V
LGATE1
POR
EN/SS1
LGATE2
G4
LDOFB
PGND
g m *V E
+
V E
-
0.8V REFERENCE
+
ENABLE
BIAS SUPPLIES
REFERENCE
FAULT LATCH
EN/SS2
EN/SS3
VCC_5V
PGND
BOOT3
UGATE3
PHASE3
SOFT-START
ADAPTIVE DEAD-TIME
FB1
180k ?
1400k ?
18.5pF
EARLY WARNING
(see Note 10)
V/I SAMPLE TIMING
VCC_5V
LGATE3
_
+
16k ?
OCP
PGOOD
PGND
EN/SS3
+ 0.8V
REF
ERROR AMP 1
-
PWM1
OV
UV
UV
PWM3
FB3
+
EN/SS1
1.3V REF
1.55μA
EN/SS1
VIN
OC3
ISEN3
OCSET3
ISEN1
CURRENT
SAMPLE
-
+
CURRENT
SAMPLE
DUTY CYCLE RAMP GENERATOR
PWM CHANNEL PHASE CONTROL
PWM2
CHANNEL 3
EN/SS2
+
OCSET1
1.75V REFERENCE
FB2
ISEN2
-
OC1
OC2
OCSET2
+
SAME STATE FOR
2 CLOCK CYCLES
REQUIRED TO LATCH
VIN
SGND
VCC_5V
CHANNEL 2
OVERCURRENT FAULT
CHANNEL 1
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